数字市场 专利库 一种速率兼容的5GLDPC码的编码装置及编码方法
一种速率兼容的5GLDPC码的编码装置及编码方法

一种速率兼容的5GLDPC码的编码装置及编码方法

注：上述费用仅包含专利权利转让费用，不包含专利年费或因年费未及时缴纳产生的滞纳金、恢复费。专利年费是专利权人依照专利法规定，自被授予专利权的当年开始，在专利权有效期内逐年应向专利局缴纳的费用。由于出售的专利类型、专利年限以及专利权人是否满足国家费用减缓的条件均会影响具体年费金额，需根据购买专利的实际情况进行缴纳。缴纳年费以及滞纳金、恢复费需单独和平台顾问确认且不属于下单后加价行为，故无法适用保障。
专利申请号：
CN202010070456.0
专利类型：
发明专利
技术分类：
H03M13/11(2006.01)I
专利有效期：
2040-01-21
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专利信息
专利名称：一种速率兼容的5GLDPC码的编码装置及编码方法
商品编号：5684534
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申请日期：2020-01-21
公开/公告号：CN111162797B
授权公告日/公开日：2023-05-30
申请/专利权人： 华**学
发明/设计人： 周林***玉成
主分类号：H03M13/11(2006.01)I
IPC分类号：H03M13/11(2006.01)I
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本发明提供一种速率兼容的5G LDPC码的编码装置及编码方法，主要解决了5G标准中LDPC码高效编码和硬件实现问题。编码过程主要包括确定编码参数，信息位的分组和缩短，校验位第一部分的计算，校验位第二部分的计算，码字拼接，码字的打孔输出等步骤，算法支持5G标准中的所有矩阵，运算速度快。编码装置通过现场可编程门阵列进行实现，主要电路可分为程序控制模块，参数计算选择模块，地址发生器，速率匹配缓冲模块，循环移位系数存储模块和编码运算模块，通过采用所提出的多路并行的电路结构可以将编码装置的吞吐率提升一倍并降低了布线复杂度，同时通过硬件复用大幅度提高了逻辑资源的利用率。

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